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Allegro高速PCB设计DDR存储器模块布局布线设计思路解析已关注关注问答 2 人已关注

2018年10月10日-2018年11月02日 allegro 分享到：收藏 1

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直播链接：http://t.elecfans.com/live/574.html

直播内容及亮点：

详解DDR高速存储器模块的布局布线的设计思路，从原理图分析到PCB布局布线，从一片到两片、四片DDR，从DDR一代到DDR四代，全面的去告诉大家应该如何去处理DDR的设计。

直播大纲：

1、DDR原理信号分析

2、DDR布局思路解析（1/2/4片）

3、DDR布线思路解析（1/2/4片）

4、DDR信号时序等长解析（1/2/4片）

5、DDR、DDR2、DDR3、DDR4区别与联系

6、你问我答10个关于DDR设计问题现场答疑

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全部问答(51) 未回答(50)

29 个回答

问
迪明Timi 2018-10-12 16:09:37提问

持续抽奖
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问
李 2018-10-12 16:17:10提问

内容还有吗？后面都是广告，这么久广告
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问
郭建盛 2018-10-12 16:21:36提问

虚拟T点怎么用
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问
李煜 2018-10-12 16:37:08提问

PPT可以下载吗
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问
张丽叶 2018-10-12 16:37:55提问

没有仿真那这些去耦靠近等都是一个定性的说法
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问
张丽叶 2018-10-12 16:44:40提问

有什么方法不仿真知道差分线的阻抗值吗和标准的100欧来比较
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问
付军涛 2018-10-12 16:51:50提问

抽过奖了么？
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问
赵恒勇 2018-10-12 16:55:31提问

延迟匹配要主芯片支持吧？
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问
赵恒勇 2018-10-12 17:00:12提问

拓补结构和带宽有关系吗？
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问
郭建盛 2018-10-12 17:01:17提问

谢谢老师
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晓nakupenda晓 2018-10-12 17:59:10提问

看不了...
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问
luozuowen 2018-10-25 17:34:36提问

如何保证T点到两片DDR之间的距离是一样长？
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问
提问

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本期嘉宾

凡亿设计经理

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深圳市凡亿技术开发有限公司设计中心技术总监；凡亿教育创始人；PCB联盟网电子论坛特邀版主；长期致力于Cadence Allegro高速PCB设计与Cadence Allegro 高速PCB设计视频教学；具备丰富的PCB设计实战经验，尤其擅长高速信号数字类、消费电子类产品的PCB设计。其系列Cadence Allegro软件速成视频教程、Cadence Allegro版PCB设计全流程实战视频深受业界PCB爱好者的赞誉，是开启PCB实战视频教学的先驱者。

嘉宾其他问答: Allegro Placement布局要点与技巧总结 92个问题 14个回答

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