【转载】Cadence Design Entry HDL 使用教程
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【Cadence02】Allegro引脚焊盘Pin设置为透明
【Cadence03】cadence不小心删掉钢网层怎么办?
【Cadence04】一般情况下Allegro PCB设计时的约束规则设置(自己瞎写)
【Cadence06】cadence HDL原理图库添加封装
【Cadence09】Cadence PCB布线时的电源地操作
【Cadence12】总结--多层板PCB绘制、丝印调整以及生成GND
【Cadence13】Cadence HDL导出BOM并将网页数据导入Excle➕坐标文件
【Cadence14】Cadence HDL原理图创建时多个VCC或GND处理方法
【Cadence15】Cadence HDL原理图打印➕allegro打印装配层丝印的技巧
【Cadence16】Cadence HDL如何拷贝模版项目?
【Cadence19】如何由PCB导出symbol器件PCB封装
【Cadence22】将别人发的原理图和PCB库修改为自己的库,进而继续制图
【Cadence23】Cadence HDL原理图如何将两个不同的全局网络连接
【Cadence25】异形板框由DXF直接导入allegro
【Cadence27】HDL拷贝工程➕Allegro导出DXF和3D文件STP
目录
1. 高速板、模拟电路在布线时,值得注意的一点:不要出现小尾巴!
本篇文章主要是为了记录下自己Allegro里面设置的快捷键F5-F9的栅格大小快速调整,分别适用于哪种情况,同时提醒一下自己,以后在PCB布局和走线阶段时可以更加方便与得心应手!
文末我会分享出来这五个快速调整栅格大小快捷键的设置env文件,一起学习,共同进步!
一、PCB绘图时的栅格快捷键说明
1. 快捷键说明
F5——快速调整栅格大小为0.1mm,主要用于PCB板框的绘制阶段;
F6——快速调整栅格大小为1mil,主要用于器件与走线微调(不常用);
F7——快速调整栅格大小为5mil,主要用于布局0402、0603等阻容器件以及走线;
F8——快速调整栅格大小为19.685mil,主要用于对Pin-Pin1.0mm的BGA器件进行布局放置;
F9——快速调整栅格大小为25mil,主要用于对芯片等大封装器件进行布局放置。
2. 对于BGA器件布局放置的一些说明:
BGA——间距1.0mm——采用F8(19.685mil)放置器件, 背面阻容 采用F8(19.685mil)放置器件;
BGA——间距0.8mm——采用F9(25mil)放置器件, 背面阻容 采用F7(5mil)放置器件。
3. env文件
将“D:\........Cadence”前面的内容更改为自己Cadence的安装路径即可!
alias F5 replay D:\Downloads\Cadence\Cadence\SPB_Data\grids\grid.01.scr
alias F6 replay D:\Downloads\Cadence\Cadence\SPB_Data\grids\grid.1.scr
alias F7 replay D:\Downloads\Cadence\Cadence\SPB_Data\grids\grid.5.scr
alias F8 replay D:\Downloads\Cadence\Cadence\SPB_Data\grids\grid.19.scr
alias F9 replay D:\Downloads\Cadence\Cadence\SPB_Data\grids\grid.25.scr
二、高速、模拟电路走线要点(天线效应)
1. 高速板、模拟电路在布线时,值得注意的一点:不要出现小尾巴!
会出现天线效应!!!!
2. 案例分析1
3. 案例分析2
错误情况👇 正确教学👇
至此,分享结束!