[从零开始学习FPGA编程-27]：进阶篇 - 基本组合电路-数据比较器（Verilog语言）

已于 2022-06-16 00:12:43 修改
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分类专栏： 从零开始学FPGA编程 文章标签： fpga开发 学习 组合电路 比较器
于 2022-06-16 00:08:09 首次发布
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本文从基础知识开始，介绍了数字电路中的数据比较器，包括比较器的位数概念，原始逻辑图，并详细讲解了如何使用Verilog HDL语言进行电路描述，强调了通过Verilog描述的简易性和灵活性。

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目录

第1章 数据比较器概述

1.1 概述

1.2 比较器的位数

1.3 原图图

1.4 verilogHDL语言表达

第1章 数据比较器概述

1.1 概述

在数字电路中，经常需要对两个位数相同的二进制数进行比较，以判断它们的相对大小或者是否相等，用来实现这一功能的逻辑电路就称为数值比较器。

数值比较器就是对两数A、B进行比较，以判断其大小的逻辑电路。

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