#systemverilog# 之浅析 DPI使用指南（一）

那么菜

已于 2022-03-28 09:55:58 修改

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分类专栏： SystemVerilog 语言编程文章标签： systemverilog

于 2022-03-22 09:48:28 首次发布

原文链接：https://mp.csdn.net/mp_blog/creation/editor

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本文介绍了如何在SystemVerilog中使用DPI，包括当C代码或SV代码量较大时的处理方法，如通过文件列表、编译共享库解决命令行长度限制。详细步骤包括：直接使用vcs命令编译，尝试文件列表方式但不支持C代码，以及通过编译C代码为共享库然后编译SV代码的方法。

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1，假设有三个文件：top.sv，dpi.h，dpi.cc
可以直接使用vcs -sverilog top.sv dpi.cc -R
但是当c代码或者sv代码都很多时，这样的操作就不合适了。

2，尝试文件列表的方式
vcs -sverilog -f filelist -R
$cat filelist
top.sv
dpi.h
dpi.cc
这样会出错，因为vcs的文件列表，不支持c代码
可以使用vcs -sverilog -f filelist dpi.cc -R
$cat filelist
top.sv

3，如果c代码和很多，那同样也会遇到cmd过长的问题，怎么解决？
解决办法：先编译c代码，shared属性；再编译sv/v代码。
g++ -Wall -m64 -g -fPIC your_cpp1.cpp your_cpp2.cpp -shared -o your_gen.so
vcs -debug_all -full64 -sverilog -R +define+your_define rtl_file.sv your_gen.so
可以写makefile来完成这些so的编译，而且不易出错。

1) First u need to generate your *.so file:
>> Example: g++ -Wall -m64 -g -fPIC your_cpp1.cpp your_cpp2.cpp -shared -o your_gen.so

2) VCS compile:
>> Example: vcs -debug_all -full64 -sverilog -R +define+your_define rtl_file.sv your_gen.so