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原创 FPGA仿真调试经验-补码运算

通过仿真发现16'd1154取补码后为-16'd31614,显然是不对的。此时已经定位问题所在,只需排查即可找出问题,通过排查发现是将符号位也同时取反了。在调试中我犯一个错误,在却补码运算中将符号位也同时取反,导致仿真结果出错。在FPGA中进行补码运算,首先将变量声明为signed。最高位为符号位,0表示正数,1表示负数。等于本身,负数的补码等于反码+1。首先明确什么是补码?

2023-10-13 17:17:58 369

原创 verilog-FAPG开发系列-4x4矩阵键盘

矩阵键盘的示意图如下图所示,为了判别某个按键按下的键值信息,采用端口扫描的方式,一般采用:向R端口扫描输入一组只有0的4为数据,如1110、1101、1011、0111,若有按键按下,则C端口有相应信息,如图S1口按下,则有{R,C}=1110_0111。

2023-05-08 20:33:21 2311 1

原创 verilog设计分频模块

在fdpg开发中分频模块是常用的功能,通过分频和计数的方式可以实现时间控制的效果。下面是一例分频模块的设计代码。

2023-05-05 21:17:37 215 1

原创 Verilog有限状态机设计

摩尔型有限状态机设计模5计数器。

2023-04-27 16:57:32 139 1

原创 verilog 时序电路-触发器

带异步清零和异步置1的JK触发器。

2023-04-26 20:15:28 1466 1

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